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摘要

描述 IEC Symbol for a NAND Gate
日期 2/06/06
來源 Own Drawing, made in Inkscape 0.43
作者 jjbeard
授權許可
(重用此檔案)
PD

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目前2008年12月21日 (日) 18:12於 2008年12月21日 (日) 18:12 版本的縮圖100 × 50(5 KB)Inductiveload{{Information |Description= |Source= |Date= |Author= |Permission= |other_versions= }}
2008年12月19日 (五) 11:01於 2008年12月19日 (五) 11:01 版本的縮圖100 × 50(5 KB)Inductiveload{{Information |Description= |Source= |Date= |Author= |Permission= |other_versions= }}
2007年5月21日 (一) 04:39於 2007年5月21日 (一) 04:39 版本的縮圖110 × 60(6 KB)JjbeardMade square (according to IEEE 91-1984 2.2, they can be any height/width ratio. However, square seems to be the convetion used for single gates in this standard. Also made larger to allow use at 100% scaling and made the outline 3px for clarity. The text
2007年5月21日 (一) 04:36於 2007年5月21日 (一) 04:36 版本的縮圖110 × 60(4 KB)Jjbeard
2006年6月2日 (五) 12:38於 2006年6月2日 (五) 12:38 版本的縮圖50 × 30(6 KB)Jjbeard{{Information |Description=IEC Symbol for a NAND Gate |Source=Own Drawing, made in Inkscape 0.43 |Date=2/06/06 |Author=jjbeard |Permission=PD |other_versions= }} Category:IEC_Logic_Gates

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